Studiare

In questa sezione è possibile reperire le informazioni riguardanti l'organizzazione pratica del corso, lo svolgimento delle attività didattiche, le opportunità formative e i contatti utili durante tutto il percorso di studi, fino al conseguimento del titolo finale.

Calendario accademico

Il calendario accademico riporta le scadenze, gli adempimenti e i periodi rilevanti per la componente studentesca, personale docente e personale dell'Università. Sono inoltre indicate le festività e le chiusure ufficiali dell'Ateneo.
L’anno accademico inizia il 1° ottobre e termina il 30 settembre dell'anno successivo.

Calendario accademico

Calendario didattico

Il calendario didattico indica i periodi di svolgimento delle attività formative, di sessioni d'esami, di laurea e di chiusura per le festività.

Anno accademico:
Definizione dei periodi di lezione
Periodo Dal Al
Periodo zero 19-set-2005 10-ott-2005
1° Q - 2° anno e successivi 3-ott-2005 2-dic-2005
1° Q - 1° Anno 17-ott-2005 2-dic-2005
2° Q 8-gen-2006 9-mar-2006
3° Q 3-apr-2006 9-giu-2006
Sessioni degli esami
Sessione Dal Al
Esami periodo 0 17-ott-2005 21-ott-2005
I Sessione esami 12-dic-2005 23-dic-2005
II Sessione esami 20-mar-2006 31-mar-2006
Sessione estiva 19-giu-2006 28-lug-2006
Sessione autunnale 4-set-2006 29-set-2006
Sessioni di lauree
Sessione Dal Al
Sessione straordinaria 14-dic-2005 14-dic-2005
Sessione invernale 15-mar-2006 15-mar-2006
Sessione estiva 19-lug-2006 19-lug-2006
Sessione autunnale 13-set-2006 13-set-2006
Vacanze
Periodo Dal Al
Festa di tutti i Santi 1-nov-2005 1-nov-2005
Immacolata Concezione 8-dic-2005 8-dic-2005
Vacanze Natalizie 23-dic-2005 7-gen-2006
Vacanze Pasquali 13-apr-2006 19-apr-2006
Festa della Liberazione 25-apr-2006 25-apr-2006
Festa dei Lavoratori 1-mag-2006 1-mag-2006
Festività Santo Patrono 21-mag-2006 21-mag-2006
Festa della Repubblica 2-giu-2006 2-giu-2006
Vacanze Estive 31-lug-2006 31-ago-2006

Calendario esami

Gli appelli d'esame sono gestiti dalla Unità Operativa Segreteria Corsi di Studio Scienze e Ingegneria.
Per consultazione e iscrizione agli appelli d'esame visita il sistema ESSE3.
Per problemi inerenti allo smarrimento della password di accesso ai servizi on-line si prega di rivolgersi al supporto informatico della Scuola o al servizio recupero credenziali

Calendario esami

Per dubbi o domande leggi le risposte alle domande più frequenti F.A.Q. Iscrizione Esami

Docenti

A B C D F G M P S V

Acquaviva Andrea

symbol email andrea.acquaviva@univr.it symbol phone-number +39 045 802 7059

Bellin Gianluigi

symbol email gianluigi.bellin@univr.it symbol phone-number +39 045 802 7969

Bonacina Maria Paola

symbol email mariapaola.bonacina@univr.it symbol phone-number +39 045 802 7046

Combi Carlo

symbol email carlo.combi@univr.it symbol phone-number +390458027985

Cristani Matteo

symbol email matteo.cristani@univr.it symbol phone-number 045 802 7983

Di Pierro Alessandra

symbol email alessandra.dipierro@univr.it symbol phone-number +39 045 802 7971

Fummi Franco

symbol email franco.fummi@univr.it symbol phone-number 045 802 7994

Giacobazzi Roberto

symbol email roberto.giacobazzi@univr.it symbol phone-number +39 045 802 7995

Manca Vincenzo

symbol email vincenzo.manca@univr.it symbol phone-number 045 802 7981

Masini Andrea

symbol email andrea.masini@univr.it symbol phone-number 045 802 7922

Mastroeni Isabella

symbol email isabella.mastroeni@univr.it symbol phone-number +390458027089

Merro Massimo

symbol email massimo.merro@univr.it symbol phone-number 045 802 7992

Monti Francesca

symbol email francesca.monti@univr.it symbol phone-number 045 802 7910

Morato Laura Maria

symbol email laura.morato@univr.it symbol phone-number 045 802 7904

Posenato Roberto

symbol email roberto.posenato@univr.it symbol phone-number +39 045 802 7967

Pravadelli Graziano

symbol email graziano.pravadelli@univr.it symbol phone-number +39 045 802 7081

Segala Roberto

symbol email roberto.segala@univr.it symbol phone-number 045 802 7997

Solitro Ugo

symbol email ugo.solitro@univr.it symbol phone-number +39 045 802 7977
Marco Squassina,  5 gennaio 2014

Squassina Marco

symbol email marco.squassina@univr.it symbol phone-number +39 045 802 7913

Vigano' Luca

symbol email luca.vigano@univr.it

Villa Tiziano

symbol email tiziano.villa@univr.it symbol phone-number +39 045 802 7034

Piano Didattico

Il piano didattico è l'elenco degli insegnamenti e delle altre attività formative che devono essere sostenute nel corso della propria carriera universitaria.
Selezionare il piano didattico in base all'anno accademico di iscrizione.

1° Anno

InsegnamentiCreditiTAFSSD
5
A
INF/01

2° Anno  Attivato nell'A.A. 2006/2007

InsegnamentiCreditiTAFSSD

3° Anno  Attivato nell'A.A. 2007/2008

InsegnamentiCreditiTAFSSD

4° Anno  Attivato nell'A.A. 2008/2009

InsegnamentiCreditiTAFSSD
InsegnamentiCreditiTAFSSD
5
A
INF/01
Attivato nell'A.A. 2006/2007
InsegnamentiCreditiTAFSSD
Attivato nell'A.A. 2007/2008
InsegnamentiCreditiTAFSSD
Attivato nell'A.A. 2008/2009
InsegnamentiCreditiTAFSSD
Insegnamenti Crediti TAF SSD
Tra gli anni: 4°- 5°Tre insegnamenti a scelta tra i seguenti

Legenda | Tipo Attività Formativa (TAF)

TAF (Tipologia Attività Formativa) Tutti gli insegnamenti e le attività sono classificate in diversi tipi di attività formativa, indicati da una lettera.




S Stage e tirocini presso imprese, enti pubblici o privati, ordini professionali

Codice insegnamento

4S00052

Crediti

5

Coordinatore

Tiziano Villa

Lingua di erogazione

Italiano

Sede

VERONA

L'insegnamento è organizzato come segue:

Teoria

Crediti

4

Periodo

2° Q

Sede

VERONA

Laboratorio

Crediti

1

Periodo

2° Q

Sede

VERONA

Obiettivi formativi

Modulo: Teoria
-------
Il corso presenta le tecniche più innovative nel campo della progettazione automatica di sistemi digitali. I concetti di base della progettazione di componenti digitali presentati nel corso di Architettura degli Elaboratori e, in parte, nel corso di Sistemi di Elaborazione dell'Informazione, sono estesi ed applicati in questo corso al mondo reale della progettazione digitale. Il flusso di progettazione proposto si basa sull'utilizzo di linguaggi per la specifica di sistemi digitali che permettono di effettuare una verifica formale delle specifiche, sintesi automatica e gestione delle problematiche relative al collaudo. Di ogni tecnica presentata si descrivono i fondamenti teorici e le applicazioni pratiche che si esemplificano con l'utilizzo dei più moderni strumenti di progettazione automatica. La teoria del corso e' messa in pratica in un laboratorio che prevede la progettazione di un sistema digitale.


Modulo: Laboratorio
-------
Il corso presenta le tecniche più innovative nel campo della progettazione automatica di sistemi digitali. I concetti di base della progettazione di componenti digitali presentati nel corso di Architettura degli Elaboratori e, in parte, nel corso di Sistemi di Elaborazione dell'Informazione, sono estesi ed applicati in questo corso al mondo reale della progettazione digitale. Il flusso di progettazione proposto si basa sull'utilizzo di linguaggi per la specifica di sistemi digitali che permettono di effettuare una verifica formale delle specifiche, sintesi automatica e gestione delle problematiche relative al collaudo. Di ogni tecnica presentata si descrivono i fondamenti teorici e le applicazioni pratiche che si esemplificano con l'utilizzo dei più moderni strumenti di progettazione automatica. La teoria del corso e' messa in pratica in un laboratorio che prevede la progettazione di un sistema digitale.

Programma

Modulo: Teoria
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Argomenti tra i seguenti:
* Sintesi logica
o Tecniche di calcolo fondamentali
o Logica a due livelli
+ Minimizzazione esatta
+ Minimizzazione euristica - Espresso
o Logica a piu' valori
+ Minimizzazione della logica a piu' valori
o Logica a piu livelli
+ Tecniche algebriche
+ Tecniche Booleane
+ Applicazioni
* I linguaggi di descrizione dei circuiti digitali:
o Sintassi e semantica del VHDL
o Simulazione VHDL temporale
o Simulazione integrata VHDL e C
o Modelli basati su macchine a stati finiti estese
* Sintesi automatica di dispositivi digitali:
o Sintesi dal livello strutturale
o VHDL per la sintesi
o Sintesi comportamentale
+ Schedulazione
+ Allocazione
o Progettazione basata su piattaforme
o La cosimulazione HW/SW
* Collaudo (Testing):
o Difetti / guasti / errori
o Generazione del collaudo combinatorio
o Generazione del collaudo sequenziale
o Sintesi per la collaudabilità
o Tolleranza ai guasti
o Autocollaudo incorporato (Built-in self-test)
* Verifica formale di circuiti:
o Verifica di equivalenza
o Verifica di proprieta'
o Tecniche per la verifica:
+ Diagrammi di decisione binaria (BDD)
+ Soddisfacibilità Booleana (SAT)


Modulo: Laboratorio
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* Laboratorio:
o Compilazione/simulazione VHDL
o Simulazione VHDL temporale
o Modellazione di FSM e FSMD con HDL Designer
o Sintesi automatica con Leonardo
o La generazione dei vettori di collaudo con Flextest
o Verifica formale con Cadence SMV

Modalità d'esame

Modulo: Teoria
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Le competenze teoriche sono verificate con una prova scritta che porta ad un voto compreso tra 16/30 e 30/30. Le attività di laboratorio mettono in grado lo studente di progettare un sistema digitale. Gli elaborati devono essere presentati entro la fine dell'anno accademico. La valutazione dell'elaborato porta ad un voto, compreso tra 1 e 4/30, che si somma al voto dello scritto.


Modulo: Laboratorio
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Le competenze teoriche sono verificate con una prova scritta che porta ad un voto compreso tra 16/30 e 30/30. Le attività di laboratorio mettono in grado lo studente di progettare un sistema digitale. Gli elaborati devono essere presentati entro la fine dell'anno accademico. La valutazione dell'elaborato porta ad un voto, compreso tra 1 e 4/30, che si somma al voto dello scritto.

Le/gli studentesse/studenti con disabilità o disturbi specifici di apprendimento (DSA), che intendano richiedere l'adattamento della prova d'esame, devono seguire le indicazioni riportate QUI

Tipologia di Attività formativa D e F

Anno accademico:

Insegnamenti non ancora inseriti

Prospettive


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Per la comunità studentesca

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